描述

SCYC55830 58063282A ABB 處理器模塊

SCYC55830 58063282A針對主從RS觸發(fā)器,當C=1時,主鎖存器輸出隨輸入S和R不斷變化。如上圖所示,假設(shè)主鎖存器輸入S為1,R為0,此時主鎖存器輸出Q被置位為1;當S變?yōu)?,R變?yōu)?,Q復(fù)位為0;當S和R都變?yōu)?,則Q保持不變?yōu)?。若此時C由1變?yōu)?,則從鎖存器接收主鎖存器的輸出,整個觸發(fā)器輸出為Q等于0。由此看來,觸發(fā)器最終輸出的結(jié)果與整個C=1期間的輸入信號變化有關(guān),而非只與下降沿到來時刻S和R的值有關(guān)。因為如果當下降沿到來的時刻S=R=0,單著S和R,無法直接知道輸出Q的取值,必須要考慮前一時刻的Q。而對于邊沿D觸發(fā)器,相當于輸入只有01和10,最終的輸出Q就是下降沿或者上升沿到來時刻輸入D的值,只需考慮當前時刻的輸入值。SCYC55830 58063282A由此觀之,兩者的區(qū)別就在于主鎖存器的區(qū)別，-個是帶輸入控制的SR鎖存器，-個是D鎖存器,前者輸出要考慮整個C=1期間輸入的情況,而C=1時后者輸出Q就等于輸入D。脈沖觸發(fā)和邊沿觸發(fā)這兩個短語很形象地形容了這一-區(qū)別。

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